XC6SLX16-2FTG256C

• forme: Appartement
• Conductive type: Circuit intégré bipolaire,
• L′intégration: MSI
• Technique: Semiconductor IC
• fabricant: xilinx
• d/c: 22+
• N° de Modèle.: XC6SLX16-2FTG256C
• package: bga-256
• qualité: original neuf
• Paquet de Transport: Box
• Origine: China
• Code SH: 8542399000
• Capacité de Production: 1000000PCS

Description de Produit

Description

XC6SLX16-2FTG256C :  FPGA - réseau de portes programmables sur site XC6SLX16-2FTG256C

MFR. N° de pièce :   XC6SLX16-2FTG256C

Fiche technique :  (envoyez-nous un e-mail ou discutez-nous pour un fichier PDF)

État ROHS :  

Qualité: 100% original

Garantie : UN AN
 

Série :	XC6SLX16
Nombre d'éléments logiques :	14579 LE
Modules de logique adaptative - Alms :	2278 ALM
Mémoire intégrée :	576 kbits
Nombre d'E/S :	186 E/S.
Tension d'alimentation - min :	1.14 V.
Tension d'alimentation - Max :	1.26 V.
Température de fonctionnement minimale :	0 °C.
Température de fonctionnement maximale :	+ 85 C.
Débit de données :	-
Nombre d'émetteurs-récepteurs :	-
Type de montage :	CMS/CMS
Emballage/caisse :	FBGA-256
Marque :	Xilinx
RAM distribuée :	136 kbits
Mémoire vive intégrée - EBR :	576 kbits
Fréquence de fonctionnement maximale :	1.08 GHz
Sensible à l'humidité :	Oui
Nombre de blocs de la matrice logique - exercices pratiques :	1139 LABO
Tension d'alimentation en fonctionnement :	1.2 V.
Type de produit :	FPGA - réseau de portes programmables sur site
Quantité de l'emballage d'usine :	1
Sous-catégorie :	Circuits intégrés logiques programmables
Nom commercial :	Spartan
Poids de l'unité :	0.238217 oz

 

 

La gamme Spartan®-6 offre des fonctionnalités d'intégration système de pointe, avec le coût total le plus bas pour les applications à gros volume. La famille de treize membres offre des densités étendues allant de 3,840 à 147,443 cellules logiques, avec la moitié de la consommation électrique des familles Spartan précédentes et une connectivité plus rapide et plus complète. Basée sur une technologie de processus cuivre à faible consommation de 45 nm et mature qui offre un équilibre optimal entre coût, puissance et performances, la famille Spartan-6 offre une nouvelle logique de table de consultation à 6 entrées (LUT) à registres doubles plus efficace et une vaste sélection de blocs intégrés au niveau du système. Ces modules incluent des RAM de blocs de 18 Ko (2 x 9 Ko), des coupes DSP48A1 de deuxième génération, des contrôleurs de mémoire SDRAM, des blocs de gestion d'horloge en mode mixte amélioré, la technologie selectio, des blocs émetteurs-récepteurs série haute vitesse optimisés, des blocs terminaux compatibles PCI Express®, des modes avancés de gestion de l'alimentation au niveau du système, des options de configuration de détection automatique, Et une sécurité IP améliorée avec AES et protection de l'ADN des appareils. Ces fonctionnalités offrent une alternative programmable à bas coût aux produits ASIC personnalisés avec une facilité d'utilisation sans précédent. Les FPGA Spartan-6 offrent la meilleure solution pour les conceptions logiques à gros volume, les conceptions DSP orientées grand public et les applications intégrées sensibles au coût. Les FPGA Spartan-6 constituent la base de données programmable des plates-formes de conception ciblées qui fournissent des composants logiciels et matériels intégrés permettant aux concepteurs de se concentrer sur l'innovation dès le début de leur cycle de développement.

Principales caractéristiques

• Spartan-6 LX FPGA : logique optimisée
• Conçu pour un coût réduit
• Blocs intégrés efficaces multiples
• Sélection optimisée des normes d'E/S.
• Coussins décalés
• Boîtiers à haut volume en plastique à fil collé
• Faible puissance statique et dynamique
• gravure en 45 nm optimisée pour un coût et une faible consommation
• Mode de mise hors tension en veille prolongée pour une consommation nulle
• Le mode suspension maintient l'état et la configuration avec activation multi-broches, amélioration des commandes
• Banques d'interface multi-tension, multi-standard selectio™
• Débit de transfert de données jusqu'à 1,080 Mbit/s par E/S différentielle
• Variateur de sortie sélectionnable, jusqu'à 24 mA par broche
• Normes et protocoles d'E/S 3,3 V à 1,2 V.
• Interfaces mémoire HSTL et SSTL économiques
• Conformité Hot Swap
• Vitesses de balayage E/S réglables pour améliorer l'intégrité du signal
• Émetteurs-récepteurs série GTP haute vitesse dans les FPGA LXT
• Jusqu'à 3.2 Go/s.
• Interfaces haut débit, notamment Serial ATA, Aurora, 1G Ethernet, PCI Express, OBSAI, CPRI, EPON, GPON, DisplayPort et XAUI
• Bloc de terminaison intégré pour conceptions PCI Express (LXT)
• Prise en charge de la technologie PCI® économique compatible avec les spécifications 33 MHz, 32 et 64 bits.
• Coupes DSP48A1 efficaces
• Calcul arithmétique et traitement du signal hautes performances
• Multiplicateur rapide 18 x 18 et accumulateur 48 bits
• Capacité de pipeline et de cascade
• Dispositif de pré-traitement pour faciliter les applications de filtre
• Blocs de contrôleur de mémoire intégré
• Prise en charge DDR, DDR2, DDR3 et LPDDR
• Débits de données jusqu'à 800 Mbit/s (bande passante de pointe de 12.8 Gbit/s)
• Structure de bus multiport avec FIFO indépendant pour réduire le temps de conception problèmes
• Ressources logiques abondantes avec une capacité logique accrue
• Prise en charge facultative du registre à décalage ou de la RAM distribuée
• Les tables LUT 6 entrées efficaces améliorent les performances et réduisent la consommation électrique
• LUT avec double bascule pour applications centrées sur les pipelines
• RAM en mode bloc avec une grande variété de granularité
• RAM bloc rapide avec activation de l'écriture d'octets
• Blocs de 18 Ko pouvant être programmés en deux Vérins indépendants de bloc 9 Kb
• Mosaïque de gestion de l'horloge (CMT) pour des performances améliorées
• Faible bruit, horloge flexible
• Les gestionnaires d'horloge numériques (DCM) éliminent l'inclinaison de l'horloge et le cycle de service distorsion
• Boucles à verrouillage de phase (PLL) pour un pointage à faible gigue
• Synthèse de fréquence avec multiplication, division et déphasage simultanés
• Seize réseaux d'horloge mondiale à faible asymétrie
• Configuration simplifiée, prise en charge de normes à faible coût
• configuration de détection automatique à 2 broches
• Prise en charge étendue de SPI (jusqu'à x4) et DE FLASH NOR tiers
• Technologie Flash Xilinx avec JTAG
• Prise en charge de la mise à niveau à distance avec plusieurs flux de bits, à l'aide de la protection de surveillance
• Sécurité renforcée pour la protection de la conception
• Identifiant unique d'ADN de dispositif pour l'authentification de conception
• Chiffrement AES par flux binaire sur les périphériques plus grands
• Traitement embarqué plus rapide avec processeur logiciel MicroBlaze™ amélioré et économique
• Des conceptions IP et de référence de pointe

 

 

 

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